RuigeLee
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69dcac95ff
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使用断言保证正确性，优化时序
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2024-10-22 17:30:03 +08:00 |
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RuigeLee
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d7ed382897
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转发fifo改名
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2024-10-22 17:12:35 +08:00 |
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RuigeLee
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f9d796b067
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插入一个buf打断时序
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2024-10-22 17:11:56 +08:00 |
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RuigeLee
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9cc388265c
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削减下行部分计数减法器
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2024-10-22 17:10:30 +08:00 |
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RuigeLee
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e0ca51875e
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时序优化，计数从1开始计，从而避免一个减法器
提前获取接收包长，提升最高频率
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2024-10-22 16:12:24 +08:00 |
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RuigeLee
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55d1e6e8e7
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bug上行测试完成
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2024-10-22 12:01:37 +08:00 |
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RuigeLee
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8950af8a47
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下行已完成
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2024-10-17 18:32:11 +08:00 |
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RuigeLee
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7e99cf4489
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1SRAM加入仿真随机初始化；2CDR物理层重新对齐包头 3复制粘贴变量错误
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2024-10-17 15:32:16 +08:00 |
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RuigeLee
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ab0fab00fa
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物理层和链路层各自有header，需要打包两次
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2024-10-17 11:43:16 +08:00 |
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RuigeLee
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84b978cbc9
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length扩充为12bits， 取头位宽错误修复
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2024-10-16 17:31:53 +08:00 |
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RuigeLee
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0dc046bffe
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仿真开始
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2024-10-16 16:17:52 +08:00 |
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RuigeLee
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55f016d866
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编译通过。准备测试
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2024-10-16 10:49:06 +08:00 |
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RuigeLee
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a44cae1ec3
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语法清理1
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2024-10-15 17:45:42 +08:00 |
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RuigeLee
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f74cc355d4
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从站初始化逻辑写完，准备编译开始第一轮测试
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2024-10-15 17:37:53 +08:00 |
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RuigeLee
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96234875b0
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从站下行写完
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2024-10-14 17:45:39 +08:00 |
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RuigeLee
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8f9aa2d17c
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从站下行的部分逻辑
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2024-10-12 17:29:58 +08:00 |
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RuigeLee
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c605fd4efe
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shin主站逻辑代码写完，没编译
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2024-10-10 17:41:49 +08:00 |
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RuigeLee
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a6068fbda0
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新主站发送逻辑
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2024-10-09 17:37:15 +08:00 |
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