Ruige Lee
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19a23c9b16
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2k fifo抽出到顶层
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2025-04-17 10:55:00 +08:00 |
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Ruige Lee
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4962e217dd
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SM模块，即用4空位fifo控制的2KB fifo
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2025-04-16 16:50:36 +08:00 |
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Ruige Lee
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9cd2e7732b
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主站行为仅为axis到sram
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2025-04-16 16:49:42 +08:00 |
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Ruige Lee
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80739a1feb
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上行转发写入正确
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2025-04-14 17:53:04 +08:00 |
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Ruige Lee
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95b7f7b476
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下行写测试通过
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2025-04-14 17:24:53 +08:00 |
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Ruige Lee
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4552cc05db
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转发功能已经调通
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2025-04-14 16:43:10 +08:00 |
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Ruige Lee
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00a7b0fe6e
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基本功能单元编译通过，开始搭建测试环境校对流水线
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2025-04-11 17:57:47 +08:00 |
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Ruige Lee
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dabfc86983
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发送单元 接收单元代码收尾
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2025-04-09 17:29:57 +08:00 |
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Ruige Lee
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d7b04710ae
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框架开始收尾，协调流水线
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2025-04-08 17:29:45 +08:00 |
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Ruige Lee
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e34338753a
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从站收发框架已成
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2025-04-07 17:39:44 +08:00 |
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Ruige Lee
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703ad172b8
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下行报文载入寄存器
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2025-04-05 09:27:15 +08:00 |
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Ruige Lee
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5bc63aaee2
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建立从站状态机
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2025-04-03 17:49:33 +08:00 |
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Ruige Lee
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658d0d1ea2
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展开文件结构
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2025-04-02 16:40:25 +08:00 |
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Ruige Lee
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6c6cce1222
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CDRIn采样率改为8x，允许参数化
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2025-04-02 15:44:32 +08:00 |
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Ruige Lee
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eec4d5c18a
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高云FPGA：dout输出反相
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2025-03-18 15:46:16 +08:00 |
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Ruige Lee
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3c63a7accc
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高云FPGA：从站增加0.5s看门狗
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2025-03-17 17:32:25 +08:00 |
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Ruige Lee
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a0799ae62f
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高云FPGA:din16默认滤波参数修改
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2025-03-12 18:06:05 +08:00 |
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Ruige Lee
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0612a99da2
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高云FPGA：dout新检测特性；删除退役的版本
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2025-03-12 17:36:10 +08:00 |
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Ruige Lee
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1da2747d44
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开放第15页2~9地址
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2025-03-11 10:19:24 +08:00 |
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Ruige Lee
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bcb1c8e8f3
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修改指令编号
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2025-03-04 14:45:31 +08:00 |
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Ruige Lee
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46cbd6edec
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rxFifo bypass to txFifo
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2025-03-04 12:01:47 +08:00 |
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Ruige Lee
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1c7eb4ce47
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使用未使用4b/5b编码作为preamble
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2025-03-04 10:58:59 +08:00 |
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c64df6956d
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合并bacon_dev分支的修改：1.增加寻找超出指定执行周期的指令；2.删除汇编中不需要的代码；3.增加协议的细节内容
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2025-03-03 10:59:07 +08:00 |
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Ruige Lee
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7f123244be
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高云FPGA：SR寄存器高3bits开放使用
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2025-02-28 10:52:07 +08:00 |
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699786b7d1
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增强查找工具的功能
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2025-02-28 09:07:59 +08:00 |
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Ruige Lee
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9937485831
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bug修复：定义CDR清中断和中断到来同时发生的行为
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2025-02-27 17:27:15 +08:00 |
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983b0337c3
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改变自定义指令查询命令的名称
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2025-02-27 14:34:55 +08:00 |
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c38cbfac2c
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合并bacon_dev分支的修改:增加搜索自定义指令的python代码
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2025-02-27 14:25:13 +08:00 |
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be7adef4aa
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合并bacon_dev分支的修改:1.协议基本运转;2.增加make debug_hlm
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2025-02-27 12:56:53 +08:00 |
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Ruige Lee
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b167d3affa
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高云FPGA：SPI发送前2byte代码规范化修复
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2025-02-26 17:27:16 +08:00 |
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Ruige Lee
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9a30c44250
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高云FPGA模块：允许SPI搬运前两byte，有隐患否？
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2025-02-26 15:40:18 +08:00 |
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Ruige Lee
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ea6ea66040
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文件结构调整
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2025-02-26 15:36:57 +08:00 |
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Ruige Lee
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598982cc95
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加入中断寄存器，加入两个32bits寄存器
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2025-02-20 19:04:30 +08:00 |
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Ruige Lee (WSL)
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b010d8704e
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Merge branch 'main' of github.com:whutddk/RISCV-MAC-SWICH into main
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2025-02-20 15:32:48 +08:00 |
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Ruige Lee (WSL)
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522d7c19c6
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try RoCC
hack 入，但io如何扇出到顶层？
Revert "hack 入，但io如何扇出到顶层？"
This reverts commit 04dd4dff462b8986d18d13ee7c6b3f17caad247c.
Revert "Revert "hack 入，但io如何扇出到顶层？""
This reverts commit a2fadc0e5524cd292ed245f1fbb5f4a688d95a1d.
CDRIN成功扇出
Rocc仿真环境
扇出RoCC请求返回的FIFO
Revert "扇出RoCC请求返回的FIFO"
This reverts commit c52777091403d300f19935df7b6de3d62c57430b.
RoCC请求返回FIFO使用FLOW模式
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2025-02-20 15:29:04 +08:00 |
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7b457e9e22
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从站邻近设备的代码正常工作，和正常转发的代码能同时工作不会产生fifo上下溢出
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2025-02-15 01:05:16 +08:00 |
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a9f741deca
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将mstStartup和slvStartup代码合二为一；增加mtime的驱动代码
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2025-02-13 22:46:21 +08:00 |
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8c3c0112fb
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增加了检测邻居的协议
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2025-02-12 19:41:33 +08:00 |
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80010b89e9
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按照状态寄存器里各个fifo的剩余字节工作，测试代码完成。测试主站正常工作
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2025-02-12 17:52:55 +08:00 |
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Ruige Lee
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45f470dc19
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Merge branch 'main' of github.com:whutddk/RISCV-MAC-SWICH into main
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2025-02-12 16:50:27 +08:00 |
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Ruige Lee
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6eaaebafcc
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fifo空间剩余
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2025-02-12 16:50:07 +08:00 |
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d87c2dacf0
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分别采用中断、查询方式优化转发时间，上传备份代码，通过控制Makefile脚本里的APP_MARCH、MABI的rv32i和rv32e来控制C语言和asm优化
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2025-02-12 15:58:50 +08:00 |
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0aa00781e5
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增加代码，调试延迟释放；对比波形，延迟释放功能正确
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2025-02-12 01:17:54 +08:00 |
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82919d861a
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增加代码，验证cdr的status寄存器，功能正确了
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2025-02-11 17:56:44 +08:00 |
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9291c6eba5
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增加反汇编里的源代码，便于与C语言对应
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2025-02-11 17:34:35 +08:00 |
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Ruige Lee
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d7effd7543
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修正tl2cdr status寄存器访问错误
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2025-02-11 17:32:08 +08:00 |
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2b4782ff4f
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削减代码，貌似解决了1个节点下的RX、TX发送连续的问题
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2025-02-11 15:23:09 +08:00 |
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Ruige Lee
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ecff635e83
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删除CDR中的硬件CDR
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2025-02-11 15:17:02 +08:00 |
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0dc8c40076
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增加plic文件，测试仿真
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2025-02-10 23:59:35 +08:00 |
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be04224806
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增加汇编代码，使用汇编模式和使用C语言的测试用例效果现在基本一样了
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2025-02-10 16:17:02 +08:00 |
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