RuigeLee
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d53d1dbe9b
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* 上下行清硬件错误的条件增加为**上**行接收到isK28_0
* 从站发生硬件错误时，软件先写`clr`寄存器预解锁，其后上行方向接收到K28_0完成正式解锁
* 预解锁需要在K28_0之前，两者在同一拍到达将只会产生预解锁效果
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2026-07-31 16:48:27 +08:00 |
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RuigeLee
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f2f2c306fe
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从站的控制码传输机制
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2026-07-30 15:59:07 +08:00 |
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RuigeLee
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4de049c05c
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主站的ctrlWord
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2026-07-30 14:51:22 +08:00 |
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RuigeLee
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3d446383e6
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* PRE改为K28_0 //0x1C
* SDF改为K28_3 //0x7C
* CDR_OUT CDR_IN补充状态state_ctrl
* 编码的isCtrl在idle转preamble，preamble处最后一个，state_ctrl有效
* CDR_OUT补充对外寄存器输入ctrlWord
* CDR_IN对齐直接看decoder的控制字组合
* CDR_IN的控制字由补充状态机STATE_CTRL过滤后输出
* PRE SDF的控制字在包末尾将允许重复使用
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2026-07-29 16:30:31 +08:00 |
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RuigeLee
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43369d87f7
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增加控制码3个必选，3个可选
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2026-07-28 17:28:49 +08:00 |
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RuigeLee
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6622bf1c73
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增加在wsl1中对sbt2.0的支持
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2026-07-28 16:10:01 +08:00 |
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RuigeLee
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db2e84c7f5
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移除4b5b特性，只使用8b10b特性
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2026-07-28 16:09:20 +08:00 |
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259a4ab2af
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更新fpga的顶层文件
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2026-05-29 08:55:50 +08:00 |
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39986b7039
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增加resource代码,将spi多合一
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2026-05-28 19:18:58 +08:00 |
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RuigeLee
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19cc932896
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专利，文档
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2026-05-12 17:31:36 +08:00 |
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RuigeLee
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a28c7076c6
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双边沿逻辑编译成功，使用scala隐式转换语法
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2026-04-17 17:04:01 +08:00 |
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4aa6d705f6
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备份模拟代码
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2026-03-25 17:39:51 +08:00 |
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578d515d3f
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重新改写一下条件语句，结构上更清晰一些
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2026-02-26 23:51:42 +08:00 |
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57ab18a492
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修正模拟代码，更精简的策略
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2026-02-26 23:39:33 +08:00 |
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b7fa4295cd
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增加shin模拟代码,尚未完成
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2026-02-26 18:10:39 +08:00 |
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75880ab7cb
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修正spi不能正常通讯的bug
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2026-02-14 23:46:47 +08:00 |
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RuigeLee
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809c2db297
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Merge branch 'dev/cleanup' of github.com:whutddk/RISCV-MAC-SWICH into dev/cleanup
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2026-02-14 09:55:49 +08:00 |
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RuigeLee
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d50076f932
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异步QSPI的方向控制挪到下降沿，时序逻辑控制
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2026-02-14 09:55:24 +08:00 |
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bec9dc12c2
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增加代码,调整了spi_1_to_4协议的时序,解决了部分bug
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2026-02-14 09:04:55 +08:00 |
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RuigeLee
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44b7aa2a5d
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增加时序约束注释
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2026-02-13 17:54:23 +08:00 |
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RuigeLee
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a46c7008b8
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移动a/bqspi读的时序
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2026-02-13 15:59:45 +08:00 |
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RuigeLee
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051dea4bda
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上升沿采样，下降沿跳变，应该约束datar到exReg的时间
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2026-02-13 12:57:01 +08:00 |
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RuigeLee
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318653f458
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Merge branch 'dev/cleanup' of github.com:whutddk/RISCV-MAC-SWICH into dev/cleanup
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2026-02-09 16:32:12 +08:00 |
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RuigeLee
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52a86fb622
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bugfix:spicmd解析比特错误
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2026-02-09 16:32:02 +08:00 |
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RuigeLee
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d59e2f0d46
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bugfix:修改444模式bitsel的行为
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2026-02-09 16:20:55 +08:00 |
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eabaa215bf
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修正写入长度的代码,aqspi\bqspi的实际长度比写入/读取长度多1个字节
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2026-02-09 16:20:08 +08:00 |
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d3e2f2969c
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修正spi协议开关的bug
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2026-02-09 15:51:11 +08:00 |
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RuigeLee
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40f559024f
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bugfix: spisel的写入位宽扩大到3bit
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2026-02-09 14:47:29 +08:00 |
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9d01b626d2
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增加测试代码，支持vqspi 4, bqspi 5
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2026-02-07 10:45:58 +08:00 |
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RuigeLee
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41bb316926
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增加144模式的同步异步qspi
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2026-02-06 10:39:02 +08:00 |
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RuigeLee
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aa25ae5b6a
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回滚spi_sel
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2026-02-06 09:26:20 +08:00 |
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RuigeLee
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4e32742de8
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Revert "面向对象方式拆分"
This reverts commit fb683c1b56.
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2026-02-05 10:53:42 +08:00 |
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RuigeLee
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fb683c1b56
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面向对象方式拆分
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2026-02-05 10:53:33 +08:00 |
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6d69760a4e
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增加清除中断的代码,解决sync.tc5的运行不正常的问题
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2026-02-03 18:20:48 +08:00 |
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78810c5a5e
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修正python生成包的顺序错误,导致硬件发包错误
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2026-02-03 16:14:41 +08:00 |
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RuigeLee
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4cbd223786
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修正bug IO三态门控制逻辑
进一步修正403e6bbb970333b5709e8d6232fa84b4fc0f4346 [403e6bb]
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2026-02-03 15:04:02 +08:00 |
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a3ce7e7c70
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发现同步的两个用例出现异常的CDROut axis overflow.
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2026-02-03 08:26:48 +08:00 |
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RuigeLee
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1dbac1b092
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bugfix:写操作单线4线切换错误
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2026-02-02 17:51:20 +08:00 |
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RuigeLee
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d3177164a9
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bug修复，异步aqspi的读操作相关byteSel以及补充读取结果pingpong选择寄存器isAsyncRead
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2026-02-02 17:44:25 +08:00 |
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2071c89ea0
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增加make testShin_vl的仿真选项,用以支持verilator的仿真;修改测试用例的数据
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2026-02-02 10:46:26 +08:00 |
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RuigeLee
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ffb4db197d
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修复sspi读丢失第一byte的问题
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2026-02-02 09:43:07 +08:00 |
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RuigeLee
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7c47137db7
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修改bug，addrr的自增byteSel和enr的byteSel
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2026-01-29 17:46:15 +08:00 |
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RuigeLee
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403e6bbb97
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修正bug IO三态门控制逻辑
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2026-01-29 17:41:51 +08:00 |
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c952a32de3
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修正测试用例里的代码错误,看波形应该是正确了
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2026-01-29 17:10:17 +08:00 |
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RuigeLee
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d0a0fe2836
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调整同步spi的enw enr的byte数
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2026-01-28 16:37:43 +08:00 |
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aac6e215d7
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修改代码，QSPI的协议从四线改到了，1to4，测试代码也做了修改
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2026-01-26 00:15:41 +08:00 |
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RuigeLee
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8d18719587
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同步采样spi改成1转4模式
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2026-01-20 16:58:01 +08:00 |
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RuigeLee
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905c6b96cf
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aqspi 部分转单线，注意datar_sync和dataw等或许需要增强约束
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2026-01-19 17:28:27 +08:00 |
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RuigeLee
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a78b8edd1a
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删除物间相关模拟寄存器
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2026-01-15 14:24:24 +08:00 |
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e8f1d5b1f1
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修改spitb clk, 可以测试cdr的偏移
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2025-10-17 20:31:23 +08:00 |
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