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# 物理层优化
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以下为用户区域
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## 8b10b模块
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* 停用4b5b特性
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- 删除选择寄存器器 h4c寄存器不再有效
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- 8b10b编码解码模块改为cdrout cdrin中例化
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* 增加部分控制码
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- 所有控制码都有极性
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- 控制码有对应原始码
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- 额外增加一条控制线
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- 控制线由发送状态机控制
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- 解码不需要极性控制
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* 增加6个控制码
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- 同时将`in(4,0)b11100".U`在`isCtrl`时映射为 `"b001111".U(6.W), "b110000".U(6.W)`
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- 3个必选 `in(7,5)`保持不变
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val isK28_0 = Output(Bool()) //0x1c
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val isK28_3 = Output(Bool()) //0x7c
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val isK28_4 = Output(Bool()) //0x9c
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- 3个备选使用宏定义控制 `in(7,5)`平衡但需要增加翻转
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* val isK28_1 = Output(Bool()) //0x3c IS_ENABLE_K28_1
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* val isK28_2 = Output(Bool()) //0x5c IS_ENABLE_K28_2
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* val isK28_6 = Output(Bool()) //0xdc IS_ENABLE_K28_6
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* PRE改为K28_0 //0x1C
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* SDF改为K28_3 //0x7C
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* CDR_OUT CDR_IN补充状态state_ctrl
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* 编码的isCtrl在idle转preamble，preamble处最后一个，state_ctrl有效
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* CDR_OUT补充对外寄存器输入ctrlWord
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* CDR_IN对齐直接看decoder的控制字组合
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* CDR_IN的控制字由补充状态机STATE_CTRL过滤后输出
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* PRE SDF的控制字在包末尾将允许重复使用
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* 主站寄存器增加"h600"指向CDR_OUT的ctrlWord
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* 从站SlaveParse层增加两个`ctrlWordRelay`寄存器，
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- 下行relay只看下行输入的6个`isK`布尔信号直接转译8bit原始码
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- 上行relay在`isProbeAck`跳变状态直接拷贝下行寄存器信息，其它条件看上行输入的6个`isK`布尔信号直接转译8bit原始码
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* 上下行清硬件错误的条件增加为**上**行接收到`isK28_0`
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* 从站发生硬件错误时，软件先写`clr`寄存器预解锁，其后上行方向接收到K28_0完成正式解锁
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* 预解锁需要在K28_0之前，两者在同一拍到达将只会产生预解锁效果
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以下是大模型补充区域
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