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ruige/eb001
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eb001/tb/sw
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bacon 8713ee0532 尚不明原因的造成了cpu的CoreID初始化错乱,导致了日志文件不能正常分离;简单粗暴地删除一个不想要的初始化语句,用以解决CoreID的错乱问题
2025-02-07 12:58:41 +08:00
..
periph
加入外设头文件,移动中断编号
2025-01-22 17:12:40 +08:00
src
尚不明原因的造成了cpu的CoreID初始化错乱,导致了日志文件不能正常分离;简单粗暴地删除一个不想要的初始化语句,用以解决CoreID的错乱问题
2025-02-07 12:58:41 +08:00
tl2cdr
增加代码,修正代码中的定义错误;测试cdr的CRC相关部分,尚未测试完全;代码正常运行
2025-02-03 23:49:50 +08:00
.gitignore
编译通过 仿真启动 请知悉 改处理器没有csr
2024-10-25 17:46:21 +08:00
bin_2_c_array.py
增加代码,将从站代码也改成RV32E和RV32I混合编程的版本
2025-02-03 14:56:04 +08:00
bin_to_coe.py
用于xilinx的SRAM代码更新
2024-11-14 17:10:54 +08:00
bin_to_hex.py
添加gpio测试,软件没有运行
2024-11-05 11:09:40 +08:00
linker.lds
增加代码,将从站代码也改成RV32E和RV32I混合编程的版本
2025-02-03 14:56:04 +08:00
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