diff --git a/src/main/scala/backBoard/ebus/CDRIn.scala b/src/main/scala/backBoard/ebus/CDRIn.scala
index 398cb18..49c0602 100644
--- a/src/main/scala/backBoard/ebus/CDRIn.scala
+++ b/src/main/scala/backBoard/ebus/CDRIn.scala
@@ -78,21 +78,33 @@ trait CDRInMultiSample{ this: CDRInBase =>
   }
 
 
-  val flitReg = for( i <- 0 until 16 ) yield {
-    if( i == 0 ) {
-      (sampleReg(15) & sampleReg(0)) |
-      (sampleReg(15) & sampleReg(1)) |
-      (sampleReg(0)  & sampleReg(1))
-    } else if ( i > 0 && i < 15 ){
-      (sampleReg(i-1) & sampleReg(i))   |
-      (sampleReg(i-1) & sampleReg(i+1)) |
-      (sampleReg(i)   & sampleReg(i+1))  
-    } else// ( i == 15 )
-      (sampleReg(14) & sampleReg(15)) |
-      (sampleReg(14) & sampleReg(0))  |
-      (sampleReg(15) & sampleReg(0)) 
+  val flitReg =
+  if(false){
+    for( i <- 0 until 16 ) yield {
+      sampleReg(i)
+    }
+  } else if (true){ //5选3 多数投票 滤波
+    for( i <- 0 until 16 ) yield {
+      (sampleReg((i-2+16)%16) & sampleReg((i-1+16)%16) & sampleReg((i+0)%16)) |
+      (sampleReg((i-2+16)%16) & sampleReg((i-1+16)%16) & sampleReg((i+1)%16)) |
+      (sampleReg((i-2+16)%16) & sampleReg((i-1+16)%16) & sampleReg((i+2)%16)) |
+      (sampleReg((i-2+16)%16) & sampleReg((i+0)%16)    & sampleReg((i+1)%16)) |
+      (sampleReg((i-2+16)%16) & sampleReg((i+0)%16)    & sampleReg((i+2)%16)) |
+      (sampleReg((i-2+16)%16) & sampleReg((i+1)%16)    & sampleReg((i+2)%16)) |
+      (sampleReg((i-1+16)%16) & sampleReg((i+0)%16)    & sampleReg((i+1)%16)) |
+      (sampleReg((i-1+16)%16) & sampleReg((i+0)%16)    & sampleReg((i+2)%16)) |
+      (sampleReg((i-1+16)%16) & sampleReg((i+1)%16)    & sampleReg((i+2)%16)) |
+      (sampleReg((i-0)%16)    & sampleReg((i+1)%16)    & sampleReg((i+2)%16))
+    }
+  } else { //3选2 多数投票 滤波
+    for( i <- 0 until 16 ) yield {
+      (sampleReg((i-1+16)%16) & sampleReg((i+0)%16)) |
+      (sampleReg((i-1+16)%16) & sampleReg((i+1)%16)) |
+      (sampleReg((i+0)%16)    & sampleReg((i+1)%16))
+    }
   }
 
+
   val arbLock = Reg(UInt( 16.W ))
 
   //优先级电路，优先选择跳变的后一相进行操作，电路上需要做成可调的
diff --git a/tb/shinTest/ShinTopSpiTb.v b/tb/shinTest/ShinTopSpiTb.v
index ef37d3f..aed854a 100644
--- a/tb/shinTest/ShinTopSpiTb.v
+++ b/tb/shinTest/ShinTopSpiTb.v
@@ -65,10 +65,6 @@ module ShinTopSpiTb(
 
     wire [4:0] io_int_sig;
 
-
-    reg _reset_deadline_ind;
-    reg _deadline_ind;
-    reg[31:0] _deadline_ind_ctr;
     reg latch0;
     reg latch1;
 
@@ -331,10 +327,6 @@ initial begin
   clk8x = 0;
 	reset = 1;
 
-  _reset_deadline_ind = 0;
-  _deadline_ind = 0;
-  _deadline_ind_ctr = 0;
-
   latch0 = 0;
   latch1 = 0;
 
@@ -391,22 +383,6 @@ begin
 	$dumpvars(0, ShinTopSpiTb);//tb模块名称
 end
 
-always @(posedge clock or posedge _reset_deadline_ind) begin
-  if (_reset_deadline_ind == 1) begin
-    _deadline_ind_ctr <= 0;
-    #30 _reset_deadline_ind <= 0;
-  end
-  else begin
-    _deadline_ind_ctr <= _deadline_ind_ctr + 1;
-  end
-  if (_deadline_ind_ctr >= 22000) begin
-    _deadline_ind <= 1;
-  end
-  else begin
-    _deadline_ind <= 0;
-  end
-end
-
 always @(posedge reset) begin
   _reset_deactive <= 1'b0;
 end
@@ -820,8 +796,11 @@ task wait_comm_finished();
         txBuf[1] = 8'h78;
         txBuf[2] = `SPI_WRITE;
         txBuf[3] = 8'h03;
+        txBuf[4] = 8'h00;
+        txBuf[5] = 8'h00;
+        txBuf[6] = 8'h00;
 
-        length = 8'h04;
+        length = 8'h07;
         idx = `IF_IQSPI(0);
 
         #5
@@ -858,18 +837,17 @@ task wait_comm_finished();
             //$display("%x %x", rxBuf[3], rxBuf[6]);
             if ((rxBuf[3] & 8'h02) == 8'h02)
             begin
-                $display("1111111111");
                 is_run = 0;
             end
             if ((rxBuf[6] & 8'h60) != 8'h00)
             begin
-                $display("222222222");
+                $display("error occur");
                 is_run = 0;
             end
-            if (($realtime - st) >= 1000000.0)
+            if (($realtime - st) >= 5000000.0)
             begin
-                $display("333333333");
-                //is_run = 0;
+                $display("comm timeout.");
+                is_run = 0;
             end
         end
     end
@@ -959,12 +937,6 @@ initial begin
     spi_trans( (16'h70), (`SPI_READ), (14), (`IF_IDX(3)) );
     spi_trans( (16'h70), (`SPI_READ), (14), (`IF_IDX(4)) );
     
-    /*
-    $display("------------------------------ start! %t", $realtime);
-    _reset_deadline_ind = 1;
-    @(posedge _deadline_ind) #5 begin end
-    $display("------------------------------ End! %t", $realtime);
-    */
   end
 
   begin:CHECK_INTERRUPT_CFG_REG
diff --git a/tb/shinTest/gen_pkt.py b/tb/shinTest/gen_pkt.py
index ad4b8a0..36d0ada 100755
--- a/tb/shinTest/gen_pkt.py
+++ b/tb/shinTest/gen_pkt.py
@@ -12,11 +12,11 @@ if __name__ == '__main__':
     #add_tc_2_runlist(errorPkt.tc4())
     
 
-    #add_tc_2_runlist(base.tc1())
-    #add_tc_2_runlist(base.tc2())
-    #add_tc_2_runlist(base.tc3())
-    #add_tc_2_runlist(base.tc4())
-    #add_tc_2_runlist(base.tc5())
+    add_tc_2_runlist(base.tc1())
+    add_tc_2_runlist(base.tc2())
+    add_tc_2_runlist(base.tc3())
+    add_tc_2_runlist(base.tc4())
+    add_tc_2_runlist(base.tc5())
     #add_tc_2_runlist(base.tc6())
     #add_tc_2_runlist(base.tc7())
     #add_tc_2_runlist(base.tc8())
@@ -38,9 +38,9 @@ if __name__ == '__main__':
 
     
     
-    add_tc_2_runlist(broadcast.tc1())
-    add_tc_2_runlist(broadcast.tc2())
-    add_tc_2_runlist(broadcast.tc3())
+    #add_tc_2_runlist(broadcast.tc1())
+    #add_tc_2_runlist(broadcast.tc2())
+    #add_tc_2_runlist(broadcast.tc3())
 
     #add_tc_2_runlist(sync.tc1())
     #add_tc_2_runlist(sync.tc2())
diff --git a/tb/shinTest/pyutils/GenPkt.py b/tb/shinTest/pyutils/GenPkt.py
index 0736367..46f04ad 100644
--- a/tb/shinTest/pyutils/GenPkt.py
+++ b/tb/shinTest/pyutils/GenPkt.py
@@ -136,9 +136,12 @@ class GenPkt(object):
 
                     #数据
                     if sp[6] == None:
-                        for _k in range(sp[5]):
-                            #self.pkt_buf[_k + i] = random.randint(0, 255)
-                            self.pkt_buf.append(random.randint(0, 255))
+                        #for _k in range(sp[5]):
+                        #    #self.pkt_buf[_k + i] = random.randint(0, 255)
+                        #    self.pkt_buf.append(random.randint(0, 255))
+                        temp = list(range(sp[5]))
+                        temp = [(i & 0xff) for i in temp]
+                        self.pkt_buf = self.pkt_buf + temp
                     else:
                         for _k in range(sp[5]):
                             #self.pkt_buf[_k + i] = sp[6][_k]
@@ -234,7 +237,6 @@ def genTrgTransPktCode(gen_name, sm_idx, wlog=True):
         
 def genReadAckPktCode(gen_name, sm_idx, wlog=True):
     return '''\n//等待回包\n'''\
-        + '''_reset_deadline_ind = 1;\n'''\
         + '''wait_comm_finished();\n'''\
         + f'''$fdisplay(spidata_file, ">>读取回包，使用SM{sm_idx}：");\n'''\
         + '''%s( (`MST_RX%d_ADDR), (`SPI_READ), (`DEF_%s_len), (`IF_IDX(0)) );\n'''%("`SPI_TRANS" if wlog else "spi_trans", sm_idx, gen_name,)
diff --git a/tb/shinTest/testcase/base.py b/tb/shinTest/testcase/base.py
index 8c55515..a05a9c5 100644
--- a/tb/shinTest/testcase/base.py
+++ b/tb/shinTest/testcase/base.py
@@ -414,7 +414,8 @@ def tc7():
     gen_file_def = "base_tc07"
     sm_idx = 0
     tc_des = "读写命令，写入0x100开始的32B寄存器，这32B寄存器实际上是只读寄存器。\\n" \
-           + "检查是否真的写入，读取的值，子报文的状态。"
+           + "检查是否真的写入，读取的值，子报文的状态。由于读写的寄存器是同步寄存器组，\\n"\
+           + "数据每次可能因为运行时间的差别，存在差异，需要手工检查。"
     
     #-------------------------------------------------------------------------
     #>>>>>>普通数据包3
@@ -471,7 +472,7 @@ def tc8():
     gen_file_def = "base_tc08"
     sm_idx = 0
     tc_des = "测试RESET，仅复位主站和2号设备；链路和网络被破坏；发送广播包只能到1,2；3,4收不到。\\n" \
-           + "通过嗅探包、设置顺序地址命令等重新建立网络。"
+           + "复位后，必须清除中断才能正常工作。通过嗅探包、设置顺序地址命令等重新建立网络。"
     
     #>>>>>>设置顺序地址
     genPkt.clean()
@@ -509,6 +510,10 @@ def tc8():
                        +genWriteTransPktCode(gen_file_def, sm_idx)
                        +genTrgTransPktCode(gen_file_def, sm_idx)
                        +genReadAckPktCode(gen_file_def, sm_idx)
+                       
+                       +genMessageCode("--清除中断")
+                       +genIFRwDataCode(0, 0x78, True, 4, [0xff, 0xff, 0xff, 0xff])
+                       +genIFRwDataCode(2, 0x78, True, 4, [0xff, 0xff, 0xff, 0xff])
                       )
     genPkt.gen("./generated/shin/%s.vh"%(gen_file_def, ), 1)
 
@@ -597,7 +602,10 @@ def tc9():
 
     gen_file_def = "base_tc09"
     sm_idx = 0
-    tc_des = "发送超过带有64个子包的读。检查子包的状态、中断、统计等信息。"
+    tc_des = ("发送超过带有64个子包的读。检查子包的状态、中断、统计等信息。\\n"
+        "由于读取了0x100同步寄存器组；0x200 eb-mmu寄存器组；0x0300数据缓冲区寄存器组；\\n"
+        "这些寄存器值和时间相关，不提供对比结果，需要手工检查。"
+        )
     
     #-------------------------------------------------------------------------
     #>>>>>>设置顺序地址
@@ -742,7 +750,9 @@ def tc10():
 
     gen_file_def = "base_tc10"
     sm_idx = 0
-    tc_des = "发送超过带有64个子包的写。检查子包的状态、中断、统计等信息。"
+    tc_des = ("发送超过带有64个子包的写。检查子包的状态、中断、统计等信息。\\n"
+              "由于访问了统计寄存器，需要手动确认这些寄存器。"
+             )
     
     #-------------------------------------------------------------------------
     #>>>>>>设置顺序地址
@@ -1134,9 +1144,11 @@ def tc_wr_sm(tc_id, wr_sm_idx):
 
     gen_file_def = f"base_tc{tc_id}_wr_sm{wr_sm_idx}"
     sm_idx = 0
-    tc_des = f"读写SM{wr_sm_idx}缓冲区超过缓冲区的元素上限，期望结果，超出缓冲区的数据不被接收，工作计数不加。\\n" \
-           + "检查是否真的写入，子报文的状态。目前即使SM0、2、4、6满了，处于溢出状态，硬件难以判断是否能提交数据。\\n"\
-           + "目前只要地址、长度正确，即使无法写入，工作计数也会加1。工作计数不能反应报文与SMx的互动关系。"
+    tc_des = (f"读写SM{wr_sm_idx}缓冲区超过缓冲区的元素上限，期望结果，超出缓冲区的数据不被接收，工作计数不加。\\n"
+              "检查是否真的写入，子报文的状态。目前即使SM0、2、4、6满了，处于溢出状态，硬件难以判断是否能提交数据。\\n"
+              "目前只要地址、长度正确，即使无法写入，工作计数也会加1。工作计数不能反应报文与SMx的互动关系。\\n"
+              "需要手动检查相应数据。"
+             )
     
     #-------------------------------------------------------------------------
     #>>>>>>普通数据包3
@@ -1221,9 +1233,11 @@ def tc_rd_sm(tc_id, rd_sm_idx):
 
     gen_file_def = f"base_tc{tc_id}_rd_sm{rd_sm_idx}"
     sm_idx = 0
-    tc_des = f"读写SM{rd_sm_idx}缓冲区超过缓冲区的元素上限，期望结果，超出缓冲区的数据不被接收，工作计数不加。\\n" \
-           + "检查是否真的写入，子报文的状态。目前即使SM1、3、5、7空了，没有数据，硬件难以判断是否存在数据。\\n"\
-           + "目前只要地址、长度正确，即使无法读取，工作计数也会加1。工作计数不能反应报文与SMx的互动关系。"
+    tc_des = (f"读写SM{rd_sm_idx}缓冲区超过缓冲区的元素上限，期望结果，超出缓冲区的数据不被接收，工作计数不加。\\n"
+              "检查是否真的写入，子报文的状态。目前即使SM1、3、5、7空了，没有数据，硬件难以判断是否存在数据。\\n"
+              "目前只要地址、长度正确，即使无法读取，工作计数也会加1。工作计数不能反应报文与SMx的互动关系。\\n"
+              "需要手工检查生成数据。"
+             )
     
     #-------------------------------------------------------------------------
     #>>>>>>普通数据包3
diff --git a/tb/shinTest/testcase/broadcast.py b/tb/shinTest/testcase/broadcast.py
index 6cfcc15..89539ce 100644
--- a/tb/shinTest/testcase/broadcast.py
+++ b/tb/shinTest/testcase/broadcast.py
@@ -78,14 +78,12 @@ def tc2():
     
     sm_size = 32
     #subPkt参数：索引、索引类型、地址、命令、长度、数据
-    data = bytearray(b"\0" * 2)
+    data = [0, ] * 2
     data[0] = sm_size & 0xff
     data[1] = (sm_size >> 8) & 0xff
     genPkt.addSubPkt(2000, 0, 0x0302, 0xe, 2, data)
     
-    data = bytearray(b"\0"*sm_size)
-    for i in range(sm_size):
-        data[i] = i + 1
+    data = list(range(1, sm_size + 1))
     genPkt.addSubPkt(2000, 0, 0x0800, 0xe, sm_size, data)
 
     sm_idx = 0
@@ -119,10 +117,10 @@ def tc2():
                        +genIFRwDataCode(4, 0x74, False, 4)
                        
                        +genMessageCode("--读取SM的状态")
-                       +genIFRwDataCode(1, 0x300, False, 0x20)
-                       +genIFRwDataCode(2, 0x300, False, 0x20)
-                       +genIFRwDataCode(3, 0x300, False, 0x20)
-                       +genIFRwDataCode(4, 0x300, False, 0x20)
+                       +genIFRwDataCode(1, 0x300, False, 0x4)
+                       +genIFRwDataCode(2, 0x300, False, 0x4)
+                       +genIFRwDataCode(3, 0x300, False, 0x4)
+                       +genIFRwDataCode(4, 0x300, False, 0x4)
                        
                        +genSlvSMReadData(1, 0, sm_size)
                        +genSlvSMReadData(2, 0, sm_size)
diff --git a/tb/shinTest/testcase/ebmmu.py b/tb/shinTest/testcase/ebmmu.py
index 354d5f3..5267fa3 100644
--- a/tb/shinTest/testcase/ebmmu.py
+++ b/tb/shinTest/testcase/ebmmu.py
@@ -939,8 +939,10 @@ def tc8():
 
     gen_file_def = "ebmmu_tc08"
     sm_idx = 0
-    tc_des = "每个从站都使用ebmmu[0]，共4个mmu，从0x1000_0000位置向后对齐，每个设备都映射0x800，每个设备占128个字节。\\n" \
+    tc_des = "每个从站都使用ebmmu[0]，从0x1000_0000位置向后对齐，每个设备都映射0x800，每个设备占128个字节。\\n" \
            + "主站使用1个子包，将4个设备的数据一次性写下去。相当于使用单播命令模拟广播命令。\\n"\
+           + "ebmmu放出的权限是0x1(只读），但子包的权限要求是只写，两相冲突，子包拒绝执行。\\n"\
+           + "从站也无法得到真正有效的数据。\\n"\
            + "检查内容：ebmmu工作状态、回包工作计数、SMx的状态、中断状态、统计信息、相关时序"
 
     #--------------------------------------------------------------------------
diff --git a/tb/shinTest/testcase_result/base_tc01_result.log b/tb/shinTest/testcase_result/base_tc01_result.log
index b8dbf2b..9acc861 100644
--- a/tb/shinTest/testcase_result/base_tc01_result.log
+++ b/tb/shinTest/testcase_result/base_tc01_result.log
@@ -1,20 +1,20 @@
 16'h030a 8'h00 16'h0002 8'h94 8'h00 
 16'h030e 8'h00 16'h0002 8'h94 8'h00 
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-16'h0074 8'h01 16'h0004 8'h10 8'h00 8'h00 8'h00 
+16'h0074 8'h01 16'h0004 8'h00 8'h00 8'h00 8'h00 
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+16'h0074 8'h01 16'h0004 8'h00 8'h00 8'h00 8'h00 
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index a112ec6..873eb4f 100644
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-16'h0074 8'h01 16'h0004 8'h10 8'h00 8'h0f 8'h00 
-16'h0074 8'h01 16'h0004 8'h10 8'h00 8'h0f 8'h00 
+16'h2800 8'h01 16'h008c 8'h08 8'h80 8'h00 8'h04 8'h00 8'h04 8'h00 8'h00 8'hd0 8'h80 8'h02 8'hf1 8'haa 8'hab 8'hae 8'haf 8'hae 8'haf 8'h5d 8'h09 8'h0f 8'h0b 8'h0c 8'h0d 8'h0e 8'h0f 8'h10 8'h11 8'h12 8'h13 8'h14 8'h15 8'h16 8'h17 8'h18 8'h19 8'h1a 8'h1b 8'h1c 8'h1d 8'h1e 8'h1f 8'h20 8'h21 8'h22 8'h23 8'h24 8'h25 8'h26 8'h27 8'h28 8'h29 8'h2a 8'h2b 8'h2c 8'h2d 8'h2e 8'h2f 8'h30 8'h31 8'h32 8'h33 8'h34 8'h35 8'h36 8'h37 8'h38 8'h39 8'h3a 8'h3b 8'h3c 8'h3d 8'h3e 8'h3f 8'h40 8'h41 8'h42 8'h43 8'h44 8'h45 8'h46 8'h47 8'h48 8'h49 8'h4a 8'h4b 8'h4c 8'h4d 8'h4e 8'h4f 8'h50 8'h51 8'h52 8'h53 8'h54 8'h55 8'h56 8'h57 8'h58 8'h59 8'h5a 8'h5b 8'h5c 8'h5d 8'h5e 8'h5f 8'h60 8'h61 8'h62 8'h63 8'h64 8'h65 8'h66 8'h67 8'h68 8'h69 8'h6a 8'h6b 8'h6c 8'h6d 8'h6e 8'h6f 8'h70 8'h71 8'h72 8'hf3 8'h74 8'h75 8'h77 8'h77 8'h78 8'h79 8'h7a 8'h7b 8'h7c 8'hfd 8'h7e 8'h7f 8'h00 8'h04 
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